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Validation éclair pour les circuits intégrés

La rédaction

Publié le 01/09/2013

Sujets relatifs :

Conception & Design, Design, TENDANCES

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Un outil d'analyse temporelle statique ultraperformant pour les systèmes complexes sur circuits intégrés a été annoncé début juin par Cadence Design Systems. Face à la complexité croissante de ces circuits, l'outil, baptisé Tempus Timing Signoff Solution, déploie de nouvelles[…]

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