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PLM : La vérification des projets électroniques passe à l'Open Source

Industrie et  Technologies
Deux éditeurs majeurs de la CAO-Electronique, Cadence et Mentor, font cause commune et mettent "l'Open Verification Methodology" en Open Source.


Cadence Design Systems et Mentor Graphics annoncent la disponibilité de la méthodologie de vérification OVM (Open Verification Methodology), récemment couronnée par le magazine Electronic Design comme la meilleure technologie de conception assistée par ordinateur en 2007.

Distribués sous la licence standard Open Source Apache 2.0, le code source OVM, la documentation et des exemples d'utilisation sont téléchargeables gratuitement à partir du site www.ovmworld.org. Le site Web OVM est le point d'accès central pour le code source d'OVM, fournissant des informations sur les partenaires, les évènements, les séminaires, les formations, les instructions à suivre et les développements futurs.

OVM est une solution basée sur le standard IEEE 1800-2005 SystemVerilog. Il s'agit de la première méthodologie de vérification SystemVerilog garantissant l'interopérabilité du langage. OVM offre une méthodologie et une bibliothèque d'accompagnement qui permettent aux utilisateurs de créer des environnements de vérification modulaires et réutilisables au sein desquels les composants communiquent entre eux via des interfaces de modélisation au niveau transaction standard.

OVM permet également la réutilisation intra et inter sociétés au travers d'une méthodologie commune, des classes pour les séquences virtuelles et la réutilisation block-to-system, ainsi qu'une intégration complète avec les langages communément utilisés dans les flux de production. Grâce à cette initiative de développement conjointe entre Mentor Graphics et Cadence Design Systems, OVM est pris en charge par plusieurs plates-formes de vérification adaptées aux besoins des ingénieurs de vérification débutants ou experts.

OVM inclut les utilitaires fondamentaux nécessaires pour construire, au sein de SystemVerilog, des environnements de vérification avancée, orientée objets et guidée par le taux de couverture permettant la vérification IP (VIP) réutilisables. OVM réduit la complexité liée à l'adoption de SystemVerilog en intégrant les pratiques de vérification au sein même de la méthodologie et des bibliothèques. Il raccourcit considérablement le temps de création des environnements de vérification. Il intègre facilement le plug-and-play VIP et assure la portabilité et la réutilisation du code.

Une version de production d'OVM est d'ores et déjà disponible et des fonctionnalités supplémentaires seront annoncées au cours de l'année 2008. Cadence et Mentor ont collaboré, afin de s'assurer que la méthodologie OVM fonctionne sur leurs simulateurs et autorise la rétro-compatibilité avec les environnements existants, Advanced Verification Methodology de Mentor Graphics, et Incisive Plan-to-Closure Methodology de Cadence.

Jean-François Prevéraud

Pour en savoir plus : http://www.mentor.com & http://www.cadence.com

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